Cadence通過面向TSMC先進工藝的PCIe 5.0 PHY和控制器 IP 規范合規性認證
發布時間：2022-06-29
來源：中國自動化網
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Cadence
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楷登電子
控制器IP
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楷登電子（美國Cadence公司）宣布，其面向TSMC N7、N6和N5工藝技術PCI Express?（PCIe?）5.0規范的PHY和控制器IP在4月舉行的業界首次PCIe 5.0規范合規認證活動中通過了PCI-SIG?的認證測試。
中國上海，2022年6月23日——楷登電子（美國Cadence公司，NASDAQ：CDNS）今日宣布，其面向TSMC N7、N6和N5工藝技術PCI Express®（PCIe®）5.0規范的PHY和控制器IP在4月舉行的業界首次PCIe 5.0規范合規認證活動中通過了PCI-SIG®的認證測試。Cadence®解決方案經過充分測試，符合PCIe 5.0技術的32GT/s全速要求。該合規計劃為設計者提供測試程序，用以評估系統級芯片（SoC）設計的PCIe 5.0接口是否會按預期運行。
面向PCIe 5.0技術的Cadence IP包括PHY、配套控制器和驗證IP（VIP），主要用于高帶寬超大規模計算、網絡和存儲應用的系統級芯片設計。利用Cadence針對PCIe 5.0架構的PHY和控制器子系統，客戶可以設計出功耗極低的系統級芯片，并加快產品上市速度。
“我們很高興看到Cadence面向TSMC先進工藝的全系列IP產品實現PCIe 5.0協議合規性?！盩SMC設計基礎設施管理部副總裁Suk Lee表示，“我們與Cadence的持續密切合作將幫助雙方客戶滿足嚴格的功耗和性能要求，并借助基于TSMC先進技術帶來的領先設計解決方案來加速芯片創新?！?br />
“憑借經過客戶驗證的最低功耗，符合PCIe 5.0規范的Cadence PHY和控制器IP使客戶能夠開發出極其節能的系統級芯片?！盋adence公司全球副總裁兼IP部總經理Sanjive Agarwala表示，“通過我們的多通道片上子系統解決方案，我們的客戶可以看到在與其目標應用相匹配的外形尺寸中實現了IP合規性?！?br />
“面向PCIe 5.0規范的Cadence PHY和控制器測試芯片在Xgig訓練器和分析儀平臺上進行的合規性測試中表現出色，與之前進行的測試結果一致。”VIAVI Solutions實驗室和產品業務部高級副總裁兼總經理Tom Fawcett表示，“Cadence在高帶寬超大規模SoC IP方面處于領先地位，他們在PCI-SIG合規活動中的成功記錄表明他們對其解決方案和整個技術的持續信心。”
“英特爾致力于通過開放的PCI Express標準進行全行業創新和嚴格的兼容性測試。”英特爾公司技術計劃總監Jim Pappas表示，“Cadence最新的PHY和控制器IP展示了他們對PCIe 5.0性能和與我們第12代英特爾酷睿和第4代英特爾至強可擴展平臺互操作性的承諾?！?br />
“作為PCI-SIG的長期成員，Cadence為PCIe技術的發展作出了很大的貢獻?！盤CI-SIG主席Al Yanes表示，“Cadence積極參與該合規計劃，幫助推動PCIe架構的不斷普及。”
面向PCIe 5.0架構的Cadence IP支持Cadence的智能系統設計（Intelligent System Design?）策略，助力實現卓越的先進節點系統級芯片設計。面向TSMC N7、N6和N5工藝技術的PCIe 5.0設計套件現已可供授權和交付。面向TSMC先進工藝的Cadence全系列設計IP解決方案還包括112G、56G、裸片到裸片（D2D）以及先進存儲器IP解決方案。
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